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(J)「FPGA開発日記」 著者 : @msyksphinz_dev：RISC-V オープンソースハードウェア 概説

 

(E) “FPGA Development Diary” Author | @msyksphinz_dev: RISC-V Open-SourceHardware Report

 

(E) RISC-V Foundation, UCB, SiFive | Krste Asanovic: Instruction Sets Want to be Free!

 

(E) SiFive | Jack Kang: SiFive 64-bit and 32-bit RISC-V CPU IP

 

(J) エスペラント | 笠原 栄二: 業界で強力な、エネルギー効率に優れた 高性能RISC-Vプロセッサ

 

(E) Esperanto | Eiji Kasahara (Speaker) Dave Ditzel (Author) : Industrial-Strength High-Performance RISC-V Processors for Energy-Efficient Computing

 

(E) Andes | Charlie Su : Taking RISC-V to Mainstream SoCs

 

RISC-V Foundation | Krste Asanovic (Presenter) Andrew Waterman (Author) RISC-V Hypervisor

 

(E) SiFive, Esperanto | Krste Asanovic, Roger Espasa : The RISC-V Vector ISA

 

(E) Redhat | Wei Fu : RISC-V PC/server OS Development Status and Proposal

 

(E) SiFive, Esperanto | Krste Asanovic, Roger Espasa : The RISC-V Vector ISA

 

(J) 塚本 明 : RISC-V Software Baseline for 32 / 64 / 128-bit CPU （日本語版）

 

(E) Akira Tsukamoto : RISC-V Software Baseline for 32 / 64 / 128-bit CPUs

 

(E) SiFive | Jack Kang : SiFive 64-bit and 32-bit RISC-V IP

 

(E) Microsemi | Ted Speers: Microsemi’s RISC-V SoftCore Processors

 

(J) NSITEXE | Hideki Sugimoto : Computer Tech. for AD gen. Vehicle ～ Outlook for RISC-V CPU ～

 

(J) シノプシス | 井手野雅明 : シノプス社 ASIP ツールによる RISC -V実装の定量評価と機能拡張

 

(E) Synopsys | Masaaki Ideno : Quantitative Evaluation and Extending RISC-V using Synopsys’s ASIP tool

 

(J) エンビテック（セガー）| 村井 一仁 : RISC-Vソフトウェア開発リューション

 

(J) SHコンサルティング | 河崎 俊平 : 日本命令アーキテクチャ苦闘史

 

(E) TechanaLye | Hiroharu Shimizu : 2020 to 2030

 

(E) Nidec | Yasushi Fukunaga : RISC-V Talk